Design on driving schedule generator for high-speed CCD camera   driving and its achievement based on CPLD technology

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Design on driving schedule generator for high-speed CCD camera driving and its achievement based on CPLD technology

更新时间：2025-09-01

- Design on driving schedule generator for high-speed CCD camera driving and its achievement based on CPLD technology
- Issue 2, Pages: 132-134(2002)
- 作者机构：
  
  1. 1:清华大学机械工程系
  2. 2:清华大学机械工程系
  3. 3:清华大学机械工程系
  4. 4:清华大学机械工程系,北京,100084
- 作者简介：
- 基金信息：
- DOI：
  CLC：
- Published：2002
- 稿件说明：
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Design on driving schedule generator for high-speed CCD camera driving and its achievement based on CPLD technology[J]. 2002, (2): 132-134.
DOI：

Design on driving schedule generator for high-speed CCD camera driving and its achievement based on CPLD technology[J]. 2002, (2): 132-134. DOI：

在分析DALSA公司的IA D1型高速CCD器件驱动时序关系的基础上

设计了可调曝光时间的高速摄像机驱动时序发生器。选用复杂可编程逻辑器件 (CPLD)作为硬件设计平台

使用VHDL语言对驱动时序发生器进行了硬件描述

采用EDA软件对所设计的驱动时序发生器进行了功能仿真

针对Lattice公司的可编程逻辑器件ISPLSI5 2 5 6进行适配。系统测试结果表明

所研制的驱动时序发生器不仅可以满足高速CCD摄像机的驱动要求

而且还能够调节其曝光时间

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